嗨嗨~大家好,這裡是九椅特報!
本站的第一篇文就獻給讓我準時畢業並順利進入某一線IC廠的"中山大學資工系乙組"分析,
讓大家了解一下這組的狀況以及畢業出路,
文末會有我對各lab的評價唷,
統計很久要細細看完餒~
中山大學資工乙在幹嘛啊?
相信很多人都覺得
"欸~資工就是在寫C、C++、PYTHON等等的程式吧!"
喔不~那是資工甲focus的部分喔,資工乙主要的研究方向會著重在數位IC相關的探討及開發,
(當然免不掉有人掛羊頭賣狗肉的啦XD)
類似的校所就像"成大電機丁""中興電機丁""中山電機己"
但相對這幾組,中山資工乙名氣小得非常多,
(數據給我出來!喔~在下面)
可以發現中山資工乙的錄取率很高耶,
(統計完才知道成大也這麼高="= 但學霸也偏多 不想越級打BOSS吧...)
這樣能在中山資工乙找一個不錯的lab看起來投資報酬率很高欸!
沒有錯啦~那就讓我繼續分析下去~
lab選擇
有研究過這組的都知道這組就是搶鄺蕭,
那究竟這兩個lab哪個比較適合你呢,
如果這兩大咖都滿了又還有什麼選擇呢,
以下就來分享一下敝人我的小小見解啦,
分析順序為:
1. 張副教授
2. 郭副教授
3. 陳副教授
4. 蕭教授
5. 鄺教授
排序無優劣就照系上網站順序而已喔XD
BTW 待會會提到的畢業出路,就大概統計一下近3~4年的而已喔
外商可能包含"Synopsys Cadence Google"
一線就大家熟悉的IC大廠"MNPSR"
1. 張副教授lab
lab近況:
身為產學大亨的一員,lab自然是扛了不少款計畫及產學,壓力確實是大一些,研究方面就完全著重在產學及計畫上,paper比較少在發了
但教授有時說話會比較直接一些,近期應該是有好一些了..吧
研究方向:
由於甲/乙組的學生都有收,所以有做純軟體的也有做硬體的,更是有人做到軟硬體整合
以硬體的角度來說,主要是會針對一些演算法實現至硬體並映射到FPGA做軟硬體整合最終實際DEMO
對於bus protocol有獨到的學習SOP,跟業界要求滿match的
完整走完整個FPGA flow"相當精實"
畢業時間: 2.2 or 2.5 or 3年
畢業出路:外商*2、一線*4、二線*n(不太清楚就n啦)
**上圖來自該老師實驗室網站
該實驗室網站有更新研究領域相關的資訊,跟我認知滿相同的 (沒什麼唬爛)
附上網址供各位參考~
(2022.01.05 updated)
2. 郭副教授lab
lab近況:
相當的美式風格,風氣非常自由奔放且快樂,可以追求人生的極致快樂XD
研究方向:
實驗室主要還是以類比為主,做數位的比較少數,據說教授也不收做數位的學生了(?
數位部分:實驗室資源較少,需要與其他實驗室借相關的EDA tool,研究應該是做到RTL simulation就可,gate-level應該不太重視(?
近期的數位研究也是著重在AI硬體加速器的設計,應該是做到RTL simulation然後寫tb用random簡單測一下這樣
類比部分:這塊我就不是太清楚,僅聽說會要求論文下線(有沒有下就不清楚了)
畢業時間: 2 or 2.5 年
畢業出路:一線*1 二線*n
3. 陳副教授lab
lab近況:
算是新創的lab,逐漸壯大中,有計畫要做也需要大量寫/發paper
教授最近剛升上副教授,學生們的loading應該會稍微輕一點了吧XD
咪挺有分大小咪,小咪要先跟學長姐討論,討論完有共識再上大咪報給教授聽,滿常咪到很晚的
之前有幾位未準時畢業的學生,至於是怎麼造成的就不好說了,但最近的學生都算有準時的喔
研究方向:
實驗室也是甲/乙組的學生都有收,所以軟硬體都有做,甚至有用到SystemC做一些硬體模擬?
而畢業有明訂畢業條件,國際論文過n篇 比賽n次等等的
主要的研究方向滿廣的,像AIOT、AI硬體加速器、Chip溫度預測等等等
畢業時間: 2 or 3年
畢業出路: 外商*2 一線*5 二線*n
(2022.01.05 updated)
**上圖來自該老師實驗室網站(研究方向真的雜XD)
4. 蕭教授lab
lab近況:
老牌lab,實驗室學長姊遍布各大科技廠,工作面試會滿吃香的
教授不接產學,每年基本上只會做一份科技部計畫養學生(?
主要會著重在發paper及教授的授課上
而實驗室的EDA tool相當齊全,可能是全南部最齊全的也說不定XD
btw 這間只收乙組的學生喔,若是上甲組就沒辦法來這間了
咪挺方式基本上每週都有咪挺,碩二需每週報進度,
碩一兩週一報,以報paper為主,其餘時間就以修課內容及加強自身能力為重,除非有被安排做計劃
研究方向:
主要在做AI的硬體加速器
訓練一個模型後用特殊的演算法來達到加速的效果
再把演算法以RTL實現
並通過RTL simulation及gate-level simulation
應該做到這有完整PPA(power, performance, area)
可以發paper就能畢業了
也有人做完整個FPGA flow並demo還有下線喔
畢業時間: 2 or 2.5年
畢業出路:一線*8 二線*n
5. 鄺教授lab
lab近況:
教授應該是全中山最暖的教授了,據說計畫paper都會自己操作,學生僅會有一兩位當支柱,其他基本上很涼很快樂
且教授最近有行政職相當忙碌,較無時間管學生
研究方向:
說真的不清楚
僅知道偶爾有科技部的計畫,也有跟其他實驗室一起做產學
需要幫教授處理行政職的雜事
總之很涼很快樂XD
畢業時間: 2年
畢業出路:外商*3 一線*2 二線*n
總結
以上是我對這幾位教授的了解~
當然還有很多沒提到的,像什麼LSM、英皇娛樂等等的,
只能說懂的人都懂XD
最後就不囉嗦來幫大家做個小評比,
若以"涼"為出發點的話:
鄺>郭>蕭>陳>張
若以"就業"為出發點的話:
蕭>鄺>張>陳>郭
若以"準時且工作發展好"為出發點的話:
蕭 > 鄺 > 其他學校晃晃 > 陳 > 張 > 郭
以上排行僅供參考囉!
若有什麼疑問想討論都歡迎留言喔!我們下回見 881~
客官們下回會想看怎麼樣的內容呢?
我目前有些想法,大家幫我分析一下啦
1. 數位IC基本能力怎麼培養(for初學者及不小心踏入研究所的新生們)
2. AMBA bus protocol深入探討(for有基礎的夥伴們一起研究bus protocol)
3.一線IC廠面試攻略(這樣好像要曝光我在哪任職了XD)
4.深入淺出IC lab實作分享(教學一些題目如何以verilog實作)
趕緊留言給我點意見啊~~

版大會想要分享到Dcard研究所版嗎? 另外想要知道數位IC的基礎能力如何培養~~小弟是今年剛加入其中一間實驗室的新生,相當迷惘哈哈哈XDD
好啊好啊~若沒有違反板規的話就麻煩多推廣了哈哈 可以的~目前預計大概一兩週會上一篇文章(工作還是很忙的QQ) 再麻煩多關注囉~
據朋友透漏,陳老師實驗室今年畢業的出路好像都不錯,今年畢業6個,三個MTK,一個Cadence。
確實今年大徵才 陳老師的畢業生們出路都很不錯! 已列入統計 謝謝您的訊息提供~
請問鄺老師收人會特別看修過那些課嗎 雖然知道老師很搶手 但還是想推推看(主修數位ic 修過邏輯設計 數位系統設計 計算機組織/結構 電子學(一) VLSI導論 預計推甄前還會修數位訊號處理導論+實驗 數位積體電路設計 數位晶片設計與實作)
同樓下所述 鄺佛感覺沒什麼特別標準 就算你正取可能也沒辦法進 直升就收滿的概念 但他近幾屆都有收到外校生就是了 就只能表現積極一點 再來就看運氣好不好了XD
回3F,鄺佛收人標準抓不到,建議正取+燒香拜拜,命運到了自然可進入佛主聖地,不打混即準時畢業工作不難找
同意~ 進去真的不要太混啦 雖然很混也能走 但這樣鄺佛好可憐哈哈
謝謝樓上兩位 另外想問如果這組推甄 如果非資工去推會有劣勢嗎 還是其實不會 就是想收電機或資工有硬體背景的
會有一點點 但影響不大 因為評書審的教授可能會有1個是純甲組的 若他不太精通電類的東西 給的分數會不高 但評分老師有5~6位 不太會因為一個人影響到全盤 我自己就是電類推上來的喔 給你參考~
不好意思,我想詢問上文提到蕭老師的學生要發paper才能畢業,是指發類似研討會的paper嗎?因為我在網路上看到有人提到老師有研究生延畢,是因為發paper不出來嗎? 還有我也想詢問老師會不會對學生有很多要求 非常抱歉問的問題有點多...
文章裡面有些小巧思是你沒注意到的喔 有些我是明確說"要發過n篇" 但有些地方又是說"跑過sim 有PPA可以發paper" 這其實是兩個不一樣的世界 以後可以細細體會~ --- 關於延畢這件事 這邊可以提出一項客觀數據 剛畢業這屆有5位學生 準時兩年畢業的有04位 80% 近4屆學生有16位學生 準時兩年畢業的有12位 75% 我想這樣的%數~ 要檢討的反而是沒辦法準時畢業的學生發生了什麼狀況吧... --- 最後 對學生要求 我想透過文中的排序就可以分析出來了吧~ 我就再補充一些給你參考 大部分的教授都是會對學生施壓來獲得產出的 但合理的施壓也才能促使你進步 同意吧? 只要自己拿捏得宜 就能在其中找到生存之道 教授是不會隨意欺壓你的! 以上 給你參考
補充一下,張教授的研究方向那張圖大多都沒有在做了,據可靠消息他實驗室網站近期會補充研究方向及內容,請期待一下。
了解~那我會再更新一下 感謝資訊
最近也剛推甄上研究所,雖然我不是中山的XD 但去年系上也有隔壁同學考試然後進張老師的實驗室 想請問張老師的實驗室沒有在做IC了是真的嗎?(聽說現在只跑FPGA驗證?) 因為當時我同學一直說他備上了也有找到做IC的老師所以我真的很好奇XD
就我所知 本來就是focus on FPGA 沒在做ASIC吧 FPGA就算是IC design的一種方式阿 怎麼會有沒在做IC一說呢
回八樓 不是沒在做IC 是不收你做IC 目前實驗室全力往軟體發展 做硬體自求多福
但我認識的還是有做到FPGA喔~
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感謝您
加個統計近五年畢業生的修業年限圖表如何?
我個人沒有這方面的資訊耶,大概也僅能觸及到我自己lab跟某些較熟的lab中上下屆,沒辦法統計到所有乙組的狀況喔 sorry~
所以每個實驗室的畢業時間統計的出處來源為何?
如上述,我僅統計我認識及我知道消息的lab喔
大大您好,有個問題想問看看您的看法。小弟目前是某地名大學資工大四(系排19%),推甄打算推中山乙組,但目前只有修過電子電路學、數位邏輯、嵌入式系統、計算機組織等相關課程,這樣的經歷適合推乙組嗎?還是說直接推甲組之後再找乙組的老師(畢竟沒找到IC相關的也能往其他領域找)。抱歉打得有點冗長。
若對verilog或程式沒概念的話不太建議去乙組耶, 別因為現在數位IC很夯就一股腦衝進去, 選自己相對擅長的方向會比較好 另外若要選甲組老師做乙組內容也""非常不建議這樣做""喔, 原因就不透漏了, 只能說救一個是一個